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Terasic友晶DE5a-Net-DDR4開發(fā)板 FAQ 集錦



DE5a-Net-DDR4

 

FAQ集錦

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Terasic DE5a-Net-DDR4 FPGA 開發(fā)板為那些需要大容量、高帶寬的內(nèi)存接口,超低延遲的通信傳輸以及高電源效率的設(shè)計提供了理想的硬件解決方案。作為一個全高,3/4標準長度的開發(fā)板,DE5a-Net-DDR4的設(shè)計滿足最苛刻的高端應(yīng)用,配備Intel Arria 10 FPGA頂級芯片,完全支持低延遲交易、云計算、高效能計算、數(shù)據(jù)采集、網(wǎng)絡(luò)處理和信號處理等高強度的應(yīng)用,為業(yè)界提供最佳的系統(tǒng)級集成和靈活性設(shè)計。

為方便大家更好得使用這塊具有強大功能的開發(fā)板,小編整理了 DE5a-Net-DDR4 FAQ 集錦,供大家參考~

 

NO.1 

DE5a-Net-DDR4 開發(fā)板上FPGA的功耗該如何測試呢?

DE5a-Net-DDR4 開發(fā)板上集成了 power monitor (電源監(jiān)測)芯片,可以用來監(jiān)測開發(fā)板上FPGA的實時功率 。

 

您只需運行 DE5a-Net-DDR4 SystemCD\Demostrations\NIOS_BASIC_DEMO\demo_batch\  目錄下的 NIOS_BASIC_DEMO.bat 文件, 即可監(jiān)測當前 FPGA 的實時功耗。詳細測試步驟可以參考 DE5a-Net-DDR4 User Manual。

 

 

NO.2

關(guān)于 DE5a-Net-DDR4 的 OpenCL 開發(fā),對 Host 端軟件環(huán)境有哪些要求?

如果您僅僅只是在 FPGA 平臺上運行 OpenCL,Host 的環(huán)境只需要安裝 Intel FPGA Runtime Environment for OpenCL 環(huán)境,即選擇安裝 Pro 版本和 Standard 版本都可以。

 

但是如果您需要編譯 OpenCL kernel,就必須安裝包含 Quartus Prime Pro 軟件的 Intel FPGA SDK for OpenCL 的完整環(huán)境。

 

 

NO.3

在虛擬機上按照文檔 DE5ANET_DDR4_OpenCL_BSP_17.1 來編譯  "hello word" 不成功,但是編譯“aoc emulator”卻可以成功 ,這是為什么呢?

因為 Opencl SDK 不支持虛擬機。您在虛擬機上通過仿真模式編譯 “aoc emulator” 成功,而且編譯時間很短,有時甚至只需幾分鐘,這是因為 emulator 并沒有真正意義上的編譯硬件,而只是通過軟件模擬。

 

 

NO.4

DE5a-Net-DDR4 板卡的 PCIe 速率能達到多少呢?能否介紹下具體的測試方法和流程呢?

PCIe 的速度與實際運行的 OS、PCIe Driver 及 APP 都有關(guān)系。

 

如果拿目前友晶官網(wǎng)發(fā)布的 OpenCL 包來測試的話,當 OpenCL 運行后,使用命令 “aocl diagnose acl0” 來測試 PCIe 速度,可以看到:PCIe 與 DDR4 協(xié)同工作時的速度在 6GB/s 左右。

 

 

NO.5

每次在 PC 機 和 DE5a-Net-DDR4 板卡斷電后,重新啟動時不能識別到 FPGA 板卡,但是運行bring_up文件夾下的 "sh test.sh" ,再重啟 PC 機后就可以正常識別,請問這是不是正?,F(xiàn)象呢?如果是,是否意味著每次斷電重啟都需要運行 test.sh 文件來識別 FPGA 板卡?

FPGA 默認 code 里面是沒有 PCIE code 的,所以需要運行 test.sh 文件,將包含 PCIE code 的 .sof  文件燒寫進  FPGA,重啟之后 PC 機才能找到 PCIE 設(shè)備。但這種方法的弊端是:關(guān)電后,配置文件不能被保存,所以每次關(guān)電重啟都需要再次配置 FPGA。

 

因此,您可以用 “aocl flash” 命令將 bitstream 燒寫進板卡上的 FLASH 器件,這樣每次開機時, FPGA 開發(fā)板就會默認從FLASH 啟動帶有 PCIE 的 code,具體方法可以參考 OpenCL 手冊。

 

 

NO.6

DE5a-Net-DDR4 開發(fā)板上的兩個 Si5340時鐘發(fā)生器可以產(chǎn)生的時鐘范圍是多少呢?應(yīng)該如何配置來產(chǎn)生自己所需的時鐘呢?

DE5a-Net-DDR4 開發(fā)板上的兩個 Si5340時鐘發(fā)生器可以為開發(fā)板上 QSFP, QDRII, DDR4 及 PCIe 等接口提供頻率可調(diào)節(jié)的參考時鐘,頻率范圍在 100Hz ~ 712.5Mhz 之間。

 

為了方便客戶建立工程,Terasic 給用戶提供了 System Builder 工具,在 System Builder 預(yù)設(shè)了幾組常用的時鐘頻率,您可以直接生成進行使用(如下圖);

如果預(yù)設(shè)值不是您所需的頻率,您還可以通過 ClockBuider Pro 軟件來生成自己所需的頻率值。詳細配置方法,可以參考DE5a-Net-DDR4 User Manual。