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RISC-V on T-Core系列課程將以Intel⑧ FPGA為平臺(tái)，介紹RISC-V處理器的設(shè)計(jì)、實(shí)現(xiàn)及應(yīng)用。該課程分為設(shè)計(jì)實(shí)現(xiàn)篇和實(shí)戰(zhàn)應(yīng)用篇。

 

設(shè)計(jì)實(shí)現(xiàn)篇不僅將從理論上對(duì)RISC-V處理器架構(gòu)進(jìn)行深入淺出的解析，還將詳細(xì)講解如何使用Verilog代碼進(jìn)行RISC-V各模塊的實(shí)現(xiàn)。

 

實(shí)戰(zhàn)應(yīng)用篇將詳細(xì)介紹RISC-V On T-Core的環(huán)境搭建和開發(fā)流程，從實(shí)戰(zhàn)出發(fā)提供Step by step的設(shè)計(jì)實(shí)例，帶你玩轉(zhuǎn)RISC-V!

 

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英特爾⑧資深工程師&友晶資深工程師

 

 

主辦單位

 

英特爾⑧FPGA大學(xué)計(jì)劃友晶科技(武漢)有限公司