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DE10-Nano套件助力全球FPGA設(shè)計(jì)大賽
關(guān)于 FPGA 創(chuàng)新大賽
創(chuàng)造嵌入式計(jì)算的未來!
亞洲、北歐和北美 Terasic 創(chuàng)新大賽激勵(lì)眾多志存高遠(yuǎn)的工程師不斷地設(shè)計(jì)、創(chuàng)造和創(chuàng)新。 今年,這些地區(qū)性比賽合并為一場全球性比賽——FPGA 創(chuàng)新大賽。屆時(shí),來自全世界的團(tuán)隊(duì)將同臺競技,他們將與 Terasic 和 Intel 一起創(chuàng)造嵌入式計(jì)算的未來。 所有人均可參賽,包括學(xué)生、教授、創(chuàng)客和企業(yè)。 團(tuán)隊(duì)可通過實(shí)際成果和實(shí)際設(shè)計(jì)展現(xiàn)創(chuàng)造力和創(chuàng)新能力。 入選團(tuán)隊(duì)將獲得免費(fèi) DE10-Nano 開發(fā)套件!
- 各地區(qū)決賽獲勝者將有幸全程免費(fèi)(即免住宿、餐飲和路費(fèi))參加于美國加利福尼亞州圣何塞市舉行的總決賽。
- 地區(qū)決賽和總決賽獲勝團(tuán)隊(duì)將獲得總額超過 30,000 美元的現(xiàn)金獎勵(lì)。
- 注冊日期截止 2017 年 12 月 31 日。

比賽平臺
Terasic DE10-Nano 開發(fā)套件采用 Intel® Cyclone® FPGA,是一款適合創(chuàng)客、教學(xué)人員和物聯(lián)網(wǎng)系統(tǒng)開發(fā)人員的可重新配置型硬件設(shè)計(jì)平臺。 該套件包含一塊具有兩個(gè)通用輸入/輸出 (GPIO) 擴(kuò)展針座和一個(gè) Arduino* 針座的板件,因而可連接多種傳感器。

特性
FPGA 器件
- Intel Cyclone® V SE 5CSEBA6U23I7 器件 (110 K LE)
- 串行配置器件 - EPCS128
- 用于編程的板載 USB-Blaster II;JTAG 模式
- HDMI TX,兼容 DVI 1.0 和 HDCP v1.4
- 兩個(gè)按鈕
- 四個(gè)滑動開關(guān)
- 八個(gè)綠色用戶 LED
- 三個(gè)由時(shí)鐘發(fā)生器提供的 50 MHz 時(shí)鐘源
- 兩個(gè) 40 引腳擴(kuò)展針座
- 一個(gè) Arduino 擴(kuò)展針座(兼容 Uno R3),可與 Arduino 擴(kuò)展板連接
- 1 個(gè) 10 引腳模擬輸入擴(kuò)展針座(與 Arduino 模擬輸入共享)
- A/D 轉(zhuǎn)換器、4 引腳 SPI,帶 FPGA
HPS(硬處理器系統(tǒng))
- 800 MHz 雙核 ARM Cortex-A9 處理器
- 1 GB DDR3 SDRAM(32 位數(shù)據(jù)總線)
- 1 千兆位以太網(wǎng) PHY RJ45 連接器
- USB OTG 端口,USB micro-AB 連接器
- 微型 SD 卡插槽
- 加速計(jì)(I²C 接口 + 中斷)
- UART 轉(zhuǎn) USB、USB Mini-B 連接器
- 暖復(fù)位按鈕和冷復(fù)位按鈕
- 一個(gè)用戶按鈕和一個(gè)用戶 LED
- LTC 2x7 擴(kuò)展針座
如何展示 FPGA 優(yōu)點(diǎn):
提升性能 ●
- 執(zhí)行一項(xiàng)任務(wù)或功能時(shí),F(xiàn)PGA 的速度快于 CPU。
- 使用 FPGA 卸載 CPU 中的任務(wù)或功能,讓處理器有空閑來執(zhí)行其他任務(wù)。
適應(yīng)變化 ●
- 使用 FPGA 執(zhí)行將隨著標(biāo)準(zhǔn)、計(jì)算方法或安全威脅變化而變化的任務(wù)或功能。
- 使用 FPGA 展示設(shè)計(jì)隨時(shí)間變化的可擴(kuò)展性,能夠不斷擴(kuò)展或提升系統(tǒng)功能。
擴(kuò)展 I/O ●
-
使用 FPGA 增加一個(gè)或多個(gè)非原生的處理器接口。
- 使用 FPGA 為應(yīng)用量身打造定制外設(shè)集。
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